Questões de Eletrônica analógica e digital para Concursos com Gabarito

61 Q781823 | Engenharia de Telecomunicações, Eletrônica analógica e digital, Técnico, Ministério da Defesa Comando da Aeronáutica, CESGRANRIO

Os amplificadores transistorizados que utilizam TJB são divididos em classes, de acordo com a maneira de amplificação dos sinais senoidais. Com relação a essas classes, considere as afirmativas a seguir.

I - O classe A amplifica integralmente os dois semiciclos (positivo e negativo).

II - O classe B amplifica um pulso simétrico, formado por parte de um semiciclo, e cuja duração é maior do que meio período da senóide.

III - O classe C amplifica um pulso simétrico, com apenas parte de um semiciclo, e cuja duração é menor do que meio período da senóide.

É(São) verdadeira(s) apenas a(s) afirmativa(s):

a) I
b) II
c) I e II
d) I e III
e) II e III

65 Q781819 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

Dado que em um código a nível de RTL, a operação: if (a ^ b) foi erroneamente trocada por: if (a | b) Que tipo de metodologia de teste e métrica de cobertura de teste provavelmente conseguirá detectar o problema?

a) Simulação direta com métrica de cobertura de linha de código.
b) Teste de equivalência de circuitos entre o RTL e o circuito sintetizado a nível de portas lógicas.
c) Simulação aleatória com métrica de cobertura de condição.
d) Simulação direta com métrica de cobertura de caminhos.
e) Simulação aleatória com métrica de cobertura de “toggle”.

68 Q781849 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

Um dos grandes problemas enfrentados no projeto digital é a falta de especificação dos atrasos nos circuitos fora do chip. Para minimizar esses problemas, uma solução é a utilização de constraints somente nas interfaces. No caso do sinal de saída, o objetivo é garantir que o sinal esteja estável pela maior tempo possível. Para um sistema com um período de clock de 30ns, quais as constraints que mais se ajustam para que o sinal de saída esteja obrigatoriamente estável por apenas 7ns (excetuando-se os tempos inerentes ao clock)?

a) create_clock –period 30 –waveform {0 15} CLK set_output_delay -max 23.0 -clock CLK {data_out} set_output_delay -min 0.0 -clock CLK {data_out}
b) create_clock –period 30 –waveform {0 15} CLK set_output_delay -max 7.0 -clock CLK {data_out} set_output_delay -min 23.0 -clock CLK {data_out}
c) create_clock –period 30 –waveform {0 7} CLK set_output_delay -max 15.0 -clock CLK {data_out} set_output_delay -min 7.0 -clock CLK {data_out}
d) create_clock –period 30 –waveform {0 7} CLK set_output_delay -max 15.0 -clock CLK {data_out} set_output_delay -min 0.0 -clock CLK {data_out}
e) create_clock –period 30 –waveform {0 15} CLK set_output_delay -max 7.0 -clock CLK {data_out} set_output_delay -min 0.0 -clock CLK {data_out}

Questões de Concursos: Eletrônica analógica e digital

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61 Q781823 | Engenharia de Telecomunicações, Eletrônica analógica e digital, Técnico, Ministério da Defesa Comando da Aeronáutica, CESGRANRIO

62 Q781673 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

63 Q781899 | Engenharia de Telecomunicações, Eletrônica analógica e digital, Auxiliar Técnico, Petrobras, CESPE CEBRASPE

64 Q781732 | Engenharia de Telecomunicações, Eletrônica analógica e digital, Engenheiro de Telecomunicações, Metrô DF, IADES

65 Q781819 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

66 Q781555 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

67 Q782070 | Engenharia de Telecomunicações, Eletrônica Analógica e Digital, Agente de Telecomunicações, Polícia Federal, CESPE CEBRASPE

68 Q781849 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

69 Q782106 | Engenharia de Telecomunicações, Eletrônica analógica e digital, FUNRIO

70 Q781475 | Engenharia de Telecomunicações, Eletrônica analógica e digital, Tecnologista Júnior, DCTA SP, VUNESP