Dois processadores, M–5 e M–7, implementam o mesmo conjunto de instruções. O processador M–5 usa um pipeline de 5 estágios e um ciclo de relógio de 10 nanosegundos. O processador M–7 usa um pipeline de 7 estágios e um ciclo de relógio de 7,5 nanosegundos. Analise as afirmativas e, a seguir, assinale a alternativa correta.
I. O pipeline do M–7 tem um desempenho máximo melhor do que o pipeline do M–5.
II. A latência de uma instrução é menor no pipeline do M–7 do que no do M–5.
III. Programa executando no M–7 sempre "rodará" mais rápido do que executando no M–5.
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